Hardwarebeschreibungssprache
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Eine Hardwarebeschreibungssprache ({{#invoke:Vorlage:lang|full|CODE=en|SCRIPTING=Latn|SERVICE=englisch}}, HDL) ist eine formale Sprache, mit der Operationen von integrierten Schaltungen und ihr Design beschrieben sowie in Simulationen getestet werden können.<ref name=":0">{{#invoke:Vorlage:Literatur|f}}</ref> Die Sprachen Verilog und VHDL gehören zu den weltweit am häufigsten genutzten Sprachen um digitale Logik zu beschreiben und sind als Industriestandards etabliert.<ref>{{#if:|{{#iferror: {{#iferror:{{#invoke:Vorlage:FormatDate|Execute}}|}}| |}}}}{{#if:Lu Dai|Lu Dai: }}{{#if:|{{#if:Make an Impact and Get Involved in Standards Development and Evolution|[{{#invoke:Vorlage:Internetquelle|archivURL|1={{#invoke:URLutil|getNormalized|1={{{archiv-url}}}}}}} {{#invoke:Vorlage:Internetquelle|TitelFormat|titel=Make an Impact and Get Involved in Standards Development and Evolution}}]{{#if:| ({{{format}}})}}{{#if:| {{{titelerg}}}{{#invoke:Vorlage:Internetquelle|Endpunkt|titel={{{titelerg}}}}}}}}}|{{#if:https://www10.edacafe.com/blogs/guest/2020/03/12/make-an-impact-and-get-involved-in-standards-development-and-evolution/%7C{{#if:{{#invoke:TemplUtl%7Cfaculty%7C}}%7C{{#invoke:Vorlage:Internetquelle%7CTitelFormat%7Ctitel={{#invoke:WLink%7CgetEscapedTitle%7C1=Make an Impact and Get Involved in Standards Development and Evolution}}}}|[{{#invoke:URLutil|getNormalized|1=https://www10.edacafe.com/blogs/guest/2020/03/12/make-an-impact-and-get-involved-in-standards-development-and-evolution/}} {{#invoke:Vorlage:Internetquelle|TitelFormat|titel={{#invoke:WLink|getEscapedTitle|1=Make an Impact and Get Involved in Standards Development and Evolution}}}}]}}{{#if:| ({{{format}}}{{#if:EDACaféInternet Business Systems Inc.2020-03-12{{#if: 2022-12-28 | {{#if:{{#invoke:TemplUtl|faculty|}}||1}}}}
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Hardwarebeschreibungssprachen drücken ein zeitliches Verhalten und/oder eine (räumliche) Schaltkreisstruktur in normalem Text aus. Im Gegensatz zu Software-Programmiersprachen beinhalten Syntax und Semantik der HDLs in ihrer Notation Möglichkeiten, zeitliche Abläufe und Gleichzeitigkeiten auszudrücken, wie es von Hardware verlangt wird. Sprachen, deren einziges Merkmal es ist, Verbindungen von elektronischen Schaltungen in Form von Netzlisten wiederzugeben, werden als Netlist-Sprachen bezeichnet.
Anwendung
Ein Grund für den Einsatz einer HDL ist die Möglichkeit der automatischen Erzeugung von Netzlisten für integrierte Schaltungen durch ein Synthesetool. So lassen sich Schaltungen beispielsweise in konfigurierbaren Mikroelektronik-Bausteinen wie Field Programmable Gate Arrays (FPGAs) oder in anwendungsspezifischen integrierten Schaltungen (ASICs) realisieren.
Für die Synthese der Schaltung, das Erzeugen einer Netzliste, ist typischerweise nur ein Teil der Sprache, bezogen auf Syntax und Semantik, geeignet. Im Bereich digitaler Schaltung kommt bevorzugt die Logiksynthese zur Anwendung. Die restlichen Teile der Sprache eignen sich zum einfacheren Modellieren einer Testumgebung zur Verifikation der Funktionsfähigkeit in Simulationsprogrammen. Ein Beispiel für ein nicht synthesefähiges Sprachkonstrukt, ist die Ein- und Ausgabe von Dateien (File-I/O), das nur in der Simulationsumgebung zur Verfügung steht. Der konkrete Umfang, welche Teile der Sprache noch synthesefähig sind, hängt von den eingesetzten Synthesewerkzeugen ab. So waren in der Anfangszeit der Logiksynthese digitale Multiplikationen nicht direkt synthetisierbar. Die im Jahr 2008 verfügbaren Werkzeuge beherrschen im Regelfall die direkte Synthese der Multiplikationsoperation in Hardware.
Folgende Abstraktionsebenen werden verwendet:
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Geschichte
VHDL
Die Entwicklung der HDL hängt generell mit der Entwicklungsgeschichte der Computerindustrie und speziell Mikroelektronik zusammen. Aufgrund zunehmender Designs, Entwicklungen und Komplexität, spendierte das amerikanische Verteidigungsministerium (DoD) in den frühen 1980er Jahren ein Programm zur Standardisierung von digitalen Systemen, dem sog. VHSIC (Very High-Speed IC)-Programm.<ref name=":0" /><ref>{{#if:|{{#iferror: {{#iferror:{{#invoke:Vorlage:FormatDate|Execute}}|}}| |}}}}{{#if:|{{{autor}}}: }}{{#if:|{{#if:VHDL|[{{#invoke:Vorlage:Internetquelle|archivURL|1={{#invoke:URLutil|getNormalized|1={{{archiv-url}}}}}}} {{#invoke:Vorlage:Internetquelle|TitelFormat|titel=VHDL}}]{{#if:| ({{{format}}})}}{{#if:| {{{titelerg}}}{{#invoke:Vorlage:Internetquelle|Endpunkt|titel={{{titelerg}}}}}}}}}|{{#if:https://semiengineering.com/knowledge_centers/languages/vhdl/%7C{{#if:{{#invoke:TemplUtl%7Cfaculty%7C}}%7C{{#invoke:Vorlage:Internetquelle%7CTitelFormat%7Ctitel={{#invoke:WLink%7CgetEscapedTitle%7C1=VHDL}}}}%7C[{{#invoke:URLutil|getNormalized|1=https://semiengineering.com/knowledge_centers/languages/vhdl/}} {{#invoke:Vorlage:Internetquelle|TitelFormat|titel={{#invoke:WLink|getEscapedTitle|1=VHDL}}}}]}}{{#if:| ({{{format}}}{{#if:SemiconductorEngineeringSMG{{#if: 2022-12-28 | {{#if:{{#invoke:TemplUtl|faculty|}}||1}}}}
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Verilog
Verilog entstand unabhängig von VHDL und wurde als HDL zur Logiksimulation (Verilog-XL) 1983 von Automated Integrated Design Systems (später: Gateway Design Automation) unter Federführung von Phil Moorby entwickelt.<ref>{{#if:|{{#iferror: {{#iferror:{{#invoke:Vorlage:FormatDate|Execute}}|}}| |}}}}{{#if:|{{{autor}}}: }}{{#if:|{{#if:Philip Moorby|[{{#invoke:Vorlage:Internetquelle|archivURL|1={{#invoke:URLutil|getNormalized|1={{{archiv-url}}}}}}} {{#invoke:Vorlage:Internetquelle|TitelFormat|titel=Philip Moorby}}]{{#if:| ({{{format}}})}}{{#if:| {{{titelerg}}}{{#invoke:Vorlage:Internetquelle|Endpunkt|titel={{{titelerg}}}}}}}}}|{{#if:https://computerhistory.org/profile/philip-moorby/%7C{{#if:{{#invoke:TemplUtl%7Cfaculty%7C}}%7C{{#invoke:Vorlage:Internetquelle%7CTitelFormat%7Ctitel={{#invoke:WLink%7CgetEscapedTitle%7C1=Philip Moorby}}}}|[{{#invoke:URLutil|getNormalized|1=https://computerhistory.org/profile/philip-moorby/}} {{#invoke:Vorlage:Internetquelle|TitelFormat|titel={{#invoke:WLink|getEscapedTitle|1=Philip Moorby}}}}]}}{{#if:| ({{{format}}}{{#if:Computer History Museum{{#if: 2022-12-28 | {{#if:{{#invoke:TemplUtl|faculty|}}||1}}}}
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KARL und ABL Sprachen
Die ersten Hardware-Beschreibungssprachen (um 1977) waren ISP (Instruction Set Processor)<ref>{{#invoke:Vorlage:Literatur|f}}</ref> von der Carnegie Mellon University, und KARL, von der Universität Karlsruhe, später weiterentwickelt an der TU Kaiserslautern.<ref>{{#invoke:Vorlage:Literatur|f}}</ref> ISP ähnelte einer Software-Programmiersprache und diente der Beschreibung des Ein-/Ausgabe-Verhaltens für die Simulation. Damit ist es allerdings kaum verwendbar für die Synthese. Zur Sprache KARL und ihrer Implementierung gehörte auch ein Entwurfs-Kalkül zur Unterstützung von „{{#invoke:Vorlage:lang|flat}}“ und strukturiertem Hardware-Entwurf. Es stellt auch die Basis von KARLs interaktiv grafischer Schwester-Sprache ABL, implementiert in den frühen 1980er Jahren beim Forschungszentrum CSELT in Turin, Italien, als grafisches VLSI-Entwurfs-System ABLED. In der Mitte der 1980er Jahre implementierte ein EU-gefördertes Konsortium ein komplettes „{{#invoke:Vorlage:lang|flat}}“ um KARL und ABL herum.<ref>{{#invoke:Vorlage:Literatur|f}}</ref> 1983 führte die Firma Data-I/O die Sprache ABEL ein, um Logik-Systeme und Schaltwerke (engl. {{#invoke:Vorlage:lang|flat}}) zu beschreiben.
Abgrenzung „Programmierung“
Regelmäßig (und fälschlicherweise) wird der Begriff Programmieren synonym für das Schreiben einer Hardwarebeschreibung benutzt. Dies resultiert daraus, dass HDLs eine ausführbare Spezifikation einer bestimmten Hardware darstellen. Ein Simulationsprogramm, das die grundlegende Semantik der Sprache und den Verlauf der Zeit bereitstellt, bietet dem Elektronikentwickler die Möglichkeit, ein Stück Hardware zu modellieren, bevor es physisch (halbleitertechnisch) hergestellt wird. Diese Möglichkeit der Ausführung lässt es so aussehen, als würde diese Sprache dazu benutzt, etwas zu „programmieren“, wobei sich diese Art der Ausführung von der Kompilierung und der Ausführung einer Software unterscheidet. Die Unterscheidung kann auch am "Ziel" der jeweiligen Methode (Software vs. Hardware) verstanden werden: Das Ergebnis bei Software ist ein ablauffähiges Programm für einen vorgegebenen Computer (z. B. Mikrocontroller). Hingegen ist das Ergebnis bei HDLs ein "Hardware-Baustein" bzw. Chip. Ein rechtliches Unterscheidungsmerkmal ist, dass sog. "computerimplementierte Erfindungen" in Deutschland patentierbar sind, hingegen reine Computerprogramme nicht. Nichtsdestotrotz wird in der Fachwelt dennoch z. B. der englische Begriff Coding im Zusammenhang mit HDLs verwendet.<ref>{{#invoke:Vorlage:Literatur|f}}</ref>
Erweiterungen & System-Sprachen
Es existieren auch HDLs und Simulatoren für das Modellieren in Digital- und Analogtechnik, bspw. die Erweiterung VHDL-AMS (kurz für: VHDL Analog-Mixed-Signal).<ref>{{#invoke:Vorlage:Literatur|f}}</ref>
Es ist möglich, Hardware semantisch in einer verbreiteten Sprache wie C++, in Verbindung mit umfangreichen Klassenbibliotheken, zu beschreiben. Diesen Ansatz verfolgt SystemC, welches aber derzeit nur in Ausnahmefällen synthesefähig ist und primär im akademischen Bereich eingesetzt wird. „Normales“ C++ enthält hingegen außerdem keine Möglichkeiten, um einen Zeitverlauf zu beschreiben, und ist deshalb nicht geeignet.
Standards
HDLs sind durch verschiedene IEEE und IEC Standards normiert. Das IEEE Design Automation Standards Committee (DASC) ist für die Normierung verantwortlich.<ref>{{#if:|{{#iferror: {{#iferror:{{#invoke:Vorlage:FormatDate|Execute}}|}}| |}}}}{{#if:|{{{autor}}}: }}{{#if:|{{#if:DASC Webpage|[{{#invoke:Vorlage:Internetquelle|archivURL|1={{#invoke:URLutil|getNormalized|1={{{archiv-url}}}}}}} {{#invoke:Vorlage:Internetquelle|TitelFormat|titel=DASC Webpage}}]{{#if:| ({{{format}}})}}{{#if:| {{{titelerg}}}{{#invoke:Vorlage:Internetquelle|Endpunkt|titel={{{titelerg}}}}}}}}}|{{#if:https://www.dasc.org/%7C{{#if:{{#invoke:TemplUtl%7Cfaculty%7C}}%7C{{#invoke:Vorlage:Internetquelle%7CTitelFormat%7Ctitel={{#invoke:WLink%7CgetEscapedTitle%7C1=DASC Webpage}}}}|[{{#invoke:URLutil|getNormalized|1=https://www.dasc.org/}} {{#invoke:Vorlage:Internetquelle|TitelFormat|titel={{#invoke:WLink|getEscapedTitle|1=DASC Webpage}}}}]}}{{#if:| ({{{format}}}{{#if:The Design Automation Standards Committee{{#if: 2022-12-28 | {{#if:{{#invoke:TemplUtl|faculty|}}||1}}}}
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Siehe auch
Weblinks
Einzelnachweise
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