Quelltext der Seite Load/Store-Architektur

Eine '''Load/Store-Architektur''' ist eine [[Prozessorarchitektur]], deren [[Befehlssatz]] Daten-Speicherzugriffe ausschließlich mit speziellen Lade- (''Load'') und Speicher-(''Store'')Befehlen erlaubt. Sie wird auch als [[Register (Prozessor)|Register]]-Register-Architektur bezeichnet.<ref>{{Webarchiv|url=https://www.et.tu-dresden.de/ifa/uploads/media/MRT1-003_Befehlssatzarchitektur_01.pdf |wayback=20160222221210 |text=Archivierte Kopie |archiv-bot=2019-04-28 04:06:42 InternetArchiveBot }} (Seite 7)</ref> [[Reduced Instruction Set Computer|RISC]]-Architekturen sind grundlegend durch ihre Eigenschaft als Load/Store-Maschinen definiert. Während klassische [[CISC]]-Architekturen für [[Arithmetisch-logische Einheit|ALU]]-Befehle (etwa Addieren oder Multiplizieren) direkten Speicherzugriff erlauben, ist dies bei Load/Store-Architekturen nur in mehreren Schritten über die Zwischenspeicherung der Argumente in Registern möglich. Daher ist der Registersatz üblicherweise im Vergleich zu CISC-Systemen größer.

Fast alle RISC-Architekturen sind Load/Store-Architekturen, Beispiele sind [[Alpha-Prozessor|Alpha]], [[Arm-Architektur|Arm]], [[MIPS-Architektur|MIPS]], [[Sun SPARC|SPARC]] und [[SuperH]].
Dagegen ist die Architektur der [[X86-Prozessor|x86]]-Prozessoren keine Load/Store-Architektur.

== Einzelnachweise ==
<references />

[[Kategorie:Rechnerarchitektur]]